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国科会扩大国际半导体人才交流 首座晶创海外基地拍板布拉格 (2024.04.14)
国科会於2023年启动「晶片驱动台湾产业创新方案」（简称「晶创台湾方案」），持续结合生成式AI及半导体晶片设计制造优势，布局台湾未来科技产业。经规划多时的首座晶创海外基地於近日拍板落脚布拉格，将连结欧洲与台湾，打造国际化的晶片设计人才培育平台，扩大基础晶片设计人才培育，并协助产业布局全球链结台湾 |
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小晶片片设计面面观：原理、设计、系统开发 (2024.04.12)
毫无疑问，先进封装绝对是半导体产业目前最引人注目的发展趋势。只不过，这是属於後段晶圆制程的工作，对於更上游、也就是晶片设计端来说，则是异质整合当道的时代 |
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台湾RISC-V联盟成立SIG工作组 推动开放架构应用能力 (2024.03.31)
由台湾物联网产业技术协会( TwIoTA )所支持成立的台湾RISC-V联盟( RVTA )，日前宣布成立「Platform SIG」及「 LLM SIG」两个工作小组，期??透过SIG工作小组的深度交流，促进产、学、研各界在RISC-V科技应用的合作，让台湾产业具备导入RISC-V开放架构的技术能力 |
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智慧家居大步走 Matter实现更好体验与可靠连结 (2024.03.26)
连接标准联盟发布的Matter，定义了下一代消费电子的连接标准。
透过家庭中已经存在的网路，将多个制造商的智慧家居设备无缝互连。
Matter承诺实现通用产品互通性、更好的使用者体验以及安全可靠的连接 |
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【东西讲座】小晶片设计面面观：原理、设计、系统开发 (2024.03.26)
毫无疑问，先进封装绝对是半导体产业目前最引人注目的发展趋势。只不过，这是属於後段晶圆制程的工作，对於更上游、也就是晶片设计端来说，则是异质整合当道的时代 |
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意法半导体高性能微控制器加速智慧家庭和工业系统开发应用 (2024.03.25)
意法半导体（STMicroelectronics；ST）推出一款结合MPU和MCU两者之长的高性能产品--STM32H7微控制器。由於微处理器（MPU）系统通常更为复杂，其处理性能、系统扩充性和资料安全性更高，而微控制器（MCU）系统之优势则是简单和整合度高 |
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日月光以VIPack小晶片互连技术协助实现AI创新应用 (2024.03.21)
因应人工智慧（(AI） 应用於多样化小晶片（chiplet）整合的需求日益增加，日月光半导体宣布，VIPack平台透过微凸块（microbump）技术将晶片与晶圆互连间距的制程能力从 40um提升到 20um，这对於在新一代的垂直整合（例如日月光 VIPack 平台2.5D 和3D 封装）与2D并排解决方案中实现创造力和微缩至关重要 |
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联发科技展示前瞻共封装光学ASIC设计平台 为次世代AI与高速运算奠基 (2024.03.20)
联发科技推出新世代客制化晶片（ASIC）设计平台，提供异质整合高速电子与光学讯号的传输介面（I/O）解决方案，以联发科技的共封装技术，整合自主研发的高速SerDes处理电子讯号传输搭配处理光学讯号传输的Ranovus Odin光学引擎 |
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COMPUTEX 2024聚焦生成式AI应用与科技 (2024.03.13)
COMPUTEX 共同主办单位 TCA（台北市电脑公会）表示，由於生成式 AI（GenAI）、LLM（大型语言模型）等 AI 科技快速发展，以及全球数位转型（DX）需求持续增加，COMPUTEX 2024（2024 台北国际电脑展）即将在 6 月 4 日至 7 日於台北南港展览馆一馆及二馆登场，以「Connecting AI（AI串联、共创未来）」为主轴，将有 1500 家海内外科技厂商，共同展出 |
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亚湾2.0以智慧科技领航国际 加速产业加值升级 (2024.03.11)
为了促进地方产业加值升级，包括高雄「亚湾2.0智慧科技创新园区推动方案」也在2024年正式启动执行！预计政府将投入170.39亿元带动孵育200家新创，并以智慧科技带动产业加值升级，重点在於扶植关键产业，带动在地就业4,200人；促进国内外厂商在地投资金额550亿元，协助提升2,200亿元产值！
经济部次长林全能表示，「亚湾2 |
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Ceva加入Arm Total Design 加速开发无线基础设施的端到端5G SoC (2024.03.11)
物联网无线连接领域IP厂商Ceva公司宣布加入Arm Total Design，目的在加速开发基於Arm Neoverse运算子系统（CSS）和Ceva PentaG-RAN 5G平台的端到端5G客制SoC，用於包括5G基地台、Open RAN设备和5G非地面网路（NTN）卫星在内在的无线基础设施 |
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imec推出首款2奈米制程设计套件 引领设计路径探寻 (2024.03.11)
於日前举行的2024年IEEE国际固态电路会议（ISSCC）上，比利时微电子研究中心（imec）推出一款开放式制程设计套件（PDK），该套件配备一套由EUROPRACTICE平台提供的共训练程式 |
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是德Chiplet PHY Designer可模拟支援UCIe标准之D2D至D2D实体层IP (2024.02.05)
是德科技（Keysight）推出Chiplet PHY Designer，这是该公司高速数位设计与模拟工具系列的最新成员，提供晶粒间（D2D）互连模拟功能，可对业界称为小晶片（Chiplet）之异质和3D积体电路设计的效能进行全面验证 |
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群联采Cadence Cerebrus AI驱动晶片最隹化工具 加速产品开发 (2024.01.31)
群联电子日前已成功采用Cadence Cerebrus智慧晶片设计工具(Intelligent Chip Explorer)和完整的Cadence RTL-to-GDS数位化全流程，优化其下一代12nm制程NAND储存控制晶片。Cadence Cerebrus为生成式AI技术驱动的解决方案，协助群联成功降低了 35%功耗及3%面积 |
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中研院成功研制5位元超导量子电脑 塑造台湾量子科技发展里程碑 (2024.01.29)
从本世纪初开始，量子科技研究已成全球趋势，全球先进国家争相投入庞大资源研发，中研院也在短短两年多的时间，自主成功研发5位元量子电脑。也期待中研院量子团队继续进步，引领台湾研究发展方向，为台湾在量子科技领域取得关键技术的领先地位而努力 |
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监别式与生成式AI相辅相成 (2024.01.27)
眼看2024年人工智慧（AI）即将成为驱动全球经济成长的动力之一，除了所需与算力相关的硬/软体，与演算法、语言模型等先进科技，就连传产中小制造业未来也有机会从中切入 |
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意法半导体新款微控制器融合无线晶片设计 提升远距应用连线效能 (2024.01.23)
意法半导体（STMicroelectronics；ST）推出新款融合无线晶片设计与高效能STM32系统架构的微控制器（MCU）。STM32WL3这款无线MCU的全新节能功能可将电池续航时间延长至15年以上 |
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创意采Cadence Integrity 3D-IC平台 实现3D FinFET 制程晶片设计 (2024.01.14)
益华电脑（Cadence）宣布，其Cadence Integrity 3D-IC 平台获创意电子采用，并已成功用於先进 FinFET 制程上实现复杂的 3D 堆叠晶片设计，并完成投片。
该设计采Cadence Integrity 3D-IC 平台，於覆晶接合（flip-chip）封装的晶圆堆叠 (WoW) 结构上实现Memory-on-Logic 三维芯片堆叠配置 |
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Ceva推出针对高阶消费和工业物联网应用的Wi-Fi 7平台 (2024.01.12)
根据ABI Research预测，至2028年，支援Wi-Fi的晶片组产品的年出货量将逾51亿个，支援Wi-Fi 7标准的晶片组将逾17亿个，致使半导体企业和OEM厂商纷纷选择在晶片设计中整合Wi-Fi连接 |
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国科会力推「晶创台湾方案」 跨部会携手驱动百业创新 (2024.01.11)
为了落实行政院在2023年11月6日核定「晶创台湾方案」，将规划2024~2033年投入3,000亿元经费，运用台湾半导体产业领先全球的优势，结合生成式AI等关键技术发展创新应用，提早布局台湾未来科技产业，并推动各行各业加速创新突破 |
