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CTIMES / 10nm Eda
科技
典故		 从演化到多元整合──浅介Bus规格标准的变迁

一个想要满足于不同市场需求的通用型Bus标准界面，能否在不断升级传输速度及加大带宽之外，达到速度、容量、质量等多元整合、提升效能为一体的愿望？
台积电认证Mentor Graphics软件可应用于其10nm FinFET技术早期设计开发 (2015.04.20)
Mentor Graphics（明导）宣布：台积电（TSMC）和Mentor Graphics已经达到在 10nm EDA认证合作的第一个里程碑。 Calibre实体验证和可制造性设计（DFM）平台以及 Analog FastSPICE（AFS）电路验证平台（包括AFS Mega）已由台积电依据最新版本的10nm设计规则和 SPICE模型认证

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