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CTIMES / 匯流排架構
科技
典故		 电子工业改革与创新者 - IEEE

IEEE的创立，是在于主导电子学的地位、促进电子学的创新，与提供会员实质上的协助。
Mentor推出原生完整的UVM SystemVerilog记忆体验证IP库 (2016.03.09)
Mentor Graphics（明导）推出首个完全原生的UVM SystemVerilog记忆体验证IP库，该记忆体验证IP库可用于所有常用记忆体设备、配置和介面。 Mentor在目前已可支援60多种常用外设介面（commonly used peripheral interfaces）和汇流排架构的Mentor验证 IP（Mentor VIP）库中新增了 1600多种记忆体模型

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