活動介紹
技術講座
「DDR4控制器SoC與PCB設計」研討會
2012年3月1日，JEDEC在加州聖克拉拉市舉行的「Server Memory Forum」上表示，DDR4已成為技術領域的新寵，不僅在伺服器上的運用，更可運用在筆記型電腦、桌上型電腦和消費性電子產品等。其速度增快以及維持I / O電壓的穩定，將可適用更廣泛層面的運用，市場潛力將引發潮流！
而新一代的DDR4記憶體，不僅處理速度更快，同時功耗更低，對於未來講求高效節能的電子裝置來說，是最佳的解決方案。此外，DIGITIMES的分析也指出，過渡到DDR4可能是目前唯一能使DRAM產業走出低谷的辦法，而在這種推力下，過渡到新的記憶體標準有望比DDR2過渡到DDR3用的時間更短。
對此，CTIMES科技論壇特別舉辦「DDR4最新技術解讀與未來發展潛能」研討會，深入介紹與剖析新一代更高性能、功耗更低的DDR4。並採宏觀的視野，尋找DDR4未來廣大的應用層面。未來的科技市場風向球在此，如此重要契機，敬請把握！
活動議程
2012-09-28
<B>報到</B>
報到及領取講義
2012-09-28
講師：陳昭宇
<B>DDR4控制晶片的SoC設計與挑戰</B>
DDR4 IP是下一世代SoC設計的重要IP之一，由DDR3邁向DDR4後，會得到更多的有效頻寬，然而同時也會碰到更多的挑戰。本場將以SoC邏輯設計的觀點介紹DDR4帶來的挑戰，包括DDR training，核心邏輯的頻率，Read latency的影響，以及SoC內部的設計瓶頸等，最後討論高速DDR量產測試的問題。
2012-09-28
<B>休息 / 產業交流</B>
2012-09-28
講師：Fan Ho
<B>DDR4的SoC與PCB設計</B>
- DDR3與DDR4的主要差異
- DDR4系統單晶片(SoC)的設計差異
- 電路板 (PCB) 的設計改變。
*本場以英文講述
2012-09-28
講師：楊雄偉
<B>DDR4記憶體設計的驗證與除錯技術</B>
DDR4頻寬速度高達3200MB / s，同時晶片密度也更加提高，而這將導致信號整合的問題，並讓工程師在進行測試時，面臨許多困難的狀況。本次的講題將針對次代DDR4記憶體的信號探測，信號捕獲，JEDEC測量，信號規範分析和高層協議解碼，提升系統設計的效能。
合作夥伴
主辦單位
CTimes
交通資訊
活動時間：2012年9月28日 13:30 - 16:40
活動地點：奔亞國際會議中心(台北市復興北路99號6樓) C室
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<font size=2<br> 一、繳費方式:匯款、ATM轉帳、信用卡、即期支票<br> ▲ 匯款/ATM轉帳<br> - 銀行：國泰世華 中山分行<br> - 帳號：國泰世華 013 帳號 042-03-500039-3<br> - 戶名：遠播資訊股份有限公司(匯款完畢務必來電/來信告知匯款日或轉出帳號末五碼)<br> ▲ 即期支票<br> - 支票抬頭：遠播資訊股份有限公司<br> - 統一編號：86278243<br> - 郵寄地址：10461 台北市中山北路三段29號11樓之3 郭家伶 收<br> <br> 二、收據：三聯式發票。活動當天於報到處索取，公司抬頭及統一編號請於報名表中註記。</font>
活動報名
立即報名參加辦法
參加方式：定價2,300元;早鳥價9/21日前1,600元; 團體三人以上1,500/人
報名洽詢：02-2585-5526 分機 335 郭小姐．madeline@ctimes.com.tw
注意事項：
1. 一般免費活動，將由主辦單位進行出席資格審核，通過審核後您將於活動日期前三日收到報到通知信函。
2. 請於活動當日報到時，以紙本或螢幕出示通知信函中之報到編號，以快速完成報到。
3. 活動當天，若報名者不克參加，可指派其他人選參加，並請事先通知主辦單位。
4. 若因不可預測之突發因素，主辦單位得保留研討會課程主題及講師之變更權利。
5. 活動若適逢颱風達放假標準等天災之不可抗拒之因素，將延期舉辦，時間則另行通知。