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Virtutech:除錯是IC設計最大挑戰
 

【CTIMES/SmartAuto 林彥慧 報導】   2006年05月05日 星期五

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有6成3的EDA開發者認為除錯是目前他們所遭遇的重大問題,幾乎是其他困難工作的兩倍,而這份調查結果由瑞典模擬軟體公司Virtutech所提供。

由IC電路模擬軟體廠商Virtutech提出的調查指出,有63%的研發人員與資訊主管認為,除錯是他們目前遭遇到最大的困難,棘手程度幾乎是其他問題的兩倍。

受訪者表示為什麼除錯是最大挑戰,總結來說,Virtutech認為受訪者指出他們使用的除錯軟體無法支持電腦多重處理器的發展,甚至有72%的受訪者認為他們實際使用硬體設備比使用除錯,在測試與發展上面來的好。

對於研發人員來說,除錯的難度在於,目前許多IC設計工作均強調多處理核心的架構,而多數受訪者使用的除錯軟體無法支援多重核心架構的電路除錯工作,甚至有72%的受訪者認為,使用硬體除錯比透過軟體除錯的方式以測試驗證IC電路容易多了。

調查結果發現研發人員真正關心的是產品的品質與效能,對研發人員而言,有效挑出錯誤的電路,肯定有助於改進IC品質。測試過程能減少錯誤發生,就可以加速交貨。而調查也發現,絕大部分的工程師只擁有6到18個月的上市研發時程。

關鍵字: EDA  除錯  Virtutech 
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