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Mentor Graphics 推出Catapult C Synthesis
以20倍速度從無時間性C++語言產生最佳化ASIC/FPGA硬體

【CTIMES/SmartAuto 黃明珠報導】   2004年06月01日 星期二

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Mentor Graphics推出Catapult C Synthesis,能利用無時間性C++語言 (untimed C++) 產生高品質暫存器轉移層級 (RTL) 描述的演算法合成工具,速度最快可達到傳統人工方式的20倍。有了Catapult C Synthesis,設計人員就能大幅減少RTL的實作時間,改善設計流程的可靠性,同時將硬體縮小。Catapult C Synthesis主要用來協助設計人員為次世代的運算密集應用發展ASIC以及FPGA元件,例如無線通訊、衛星通訊和視訊影像處理。結合系統層級和硬體設計,Catapult C Synthesis可以搭配Mentor Graphic ModelSim模擬器,為以C語言為基礎的設計流程創造出基本架構。

Mentor Graphics設計建立與合成部門總經理Simon Bloch表示,Mentor與專門設計高複雜性元件的重要電子廠商密切合作,共同發展和證明Catapult C Synthesis工具的優點。根據超過10個Tapeout的結果顯示,這些公司都能產生可靠硬體,其體積最多減少一半,而且所需時間大幅縮短。毫無疑問的,Mentor Graphics的Catapult C Synthesis工具將對未來以C語言為基礎的ASIC和FPGA設計產生重大衝擊。

關鍵字: 明導國際(Mentor Graphics明導國際(Mentor Graphics
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