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| 開始時間﹕ |
十二月十一日(六) 09:00 |
結束時間﹕ |
十二月十一日(六) 16:00 |
| 主办单位﹕ |
財團法人自強工業科學基金會 |
| 活動地點﹕ |
财团法人自强工业科学基金会 |
| 联 络 人 ﹕ |
傅小姐 |
联络电话﹕ |
03-5714868ext.3801 |
| 報名網頁﹕ |
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| 相关网址﹕ |
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(1)Introduction Verilog code--HDL的基本概念 (2)基本Verilog 描述--如何用Verilog写出一个简单的电路 (3)合成 (4)高阶Verilog描述--使用DesignWare来设计﹔如何用Verilog写出一个系统电路 (5)HDL自动验证写法--如何直接用HDL描述来自动验证是否正确 (6)HDL Coding Style Basic Coding Coding for Portability Guidelines for Clock and Resets Coding for Synthesis Partition for Synthesis Design with Memories Module Compilation (7)Case study -以一个8bits的微处理器为例﹔CORDIC (用于数字讯号处理单元)
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